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时间频率学报
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基于DDS技术的Loran-C信号源的杂散信号抑制的分析与实现
文章来源: 发布时间:2015-12-18 字体大小:【

  皇甫江1,2,3,华宇1,2,李实锋1,2 

  1. 中国科学院国家授时中心,西安 710600 

   2. 中国科学院精密导航定位与定时技术重点实验室,西安 710600 

  3. 中国科学院大学,北京 100049     

  摘要采用直接数字频率合成(DDS)技术设计的Loran-C信号源,具有输出杂散多且难以预测的缺点。基于对DDS本原理的研究分析,针对DDS输出信号存在的相位舍位杂散问题,对其关键部位的相位累加模块进行优化设计,并基于FPGA技术,在Quartus环境下完成了对Loran-C信号源的实现与仿真验证。结果表明,通过优化的设计算法能够产生失真小,稳定度好的输出波形,从而验证了该方法抑制杂散的有效性与可行性。 

      词:罗兰-C;直接数字频率合成;相位舍位杂散;相位累加;现场可编程门阵列(FPGA 

  中图分类号:TN911.4 

  文献标志码:A                      文章编号:1674-0637(2014)01-0041-08 

    

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